常用外围器件 | taohu的站

1.实时数据采集

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Σ-Δ调制方式是根据前一采样值与后一采样值之差进行量化编码,根据信号的包络形状进行量化编码的,采用了过采样技术.

积分方式是通过积分电路把线性模拟电压转换成时间信号，在这段时间内通过计数器对标准时钟脉冲计数，计数值反映了模拟电压的大小。（精度高,抗干扰能力强,速度较慢）

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并行比较型(FLASH ADC)模数转换器是目前可以见到的速度最快的ADC，分辨率一般为8位，最高可达12位，采样速率可以达到500MSPS，全功率带宽大于300MHz。并行比较型数模转换器结构比较简单，它由分压电阻网络、比较器阵列和优先编码器组成

串－并比较型,解决高速、高分辨ADC的另一种设计思路是将两个或多个低分辨率的并行比较型ADC级联起来，合并成一个高分辨的ADC。为了减少比较器的数量，或为了达到更高的分辨率，

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动态有效位(ENOB)，是用来衡量数据采集系统实际工作时有效的位数，它是用分辨率来衡量实际工作时ADC的噪声均方值与理想ADC标识分辨率情况下的量化噪声。

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ECL存储：速度快，容量小，功耗低 同步存储：速度快

双端口存储器是一种专用存储芯片，设有两组物理地址、数据和读写控制信号。两个CPU可以通过这些控制信号同时访问双端口存储器，实现数据共享。

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人为的将双端口存储器分成两部分，使得存储器的读写操作分时工作，即同一时刻内存储器的两部分处于不同的读写状态

有效的增加了DSP运算处理时间，提高了系统的实时性。重点在于双端口存储器的地址切换。一般用CPLD或FPGA来设计实现

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FIFO是一种先进先出的存储器，即先读入的数据先读出。FIFO器件常用作数据缓冲器，充当两个不同速率的系统之间的数据接口。 FIFO的共性：没有地址线，只有读写时钟，内部地址依赖于对读写时钟的计数。采用满、空、半满标志来标识存储状态。

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使用时要注意电平和速度匹配器件选型时要注意以下性能指标：  输入输出兼容性  驱动能力  静态电流以及速度